米Cadence Design Systems, Inc.は,同社のSoC設計向けEDAの新概念「Silicon Realization」の機能検証フローに関して発表した。同社によれば,ポイントはカバレッジ・ドリブン検証の強化,およびUVM(Universal Verification Methodology)1.0正式版への完全対応の2点である。
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