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HOMEエレクトロニクス電子設計ITC(International Test Conference)2013 > 高速IOのジッタ耐力テストでLSI社が新手法、BIST回路でサイン波ジッタを発生して注入

ITC(International Test Conference)2013

高速IOのジッタ耐力テストでLSI社が新手法、BIST回路でサイン波ジッタを発生して注入

  • 山口隆弘=アドバンテスト研究所
  • 2013/09/20 12:28
  • 1/1ページ
高速シリアルIOデバイスのテストで、最も重要で効果的かつ最も困難なのが受信機のジッタ耐力テストである。テストの国際会議「ITC(International Test Conference)」では、早くも2002年のITC 2002において、ジッタ耐力テストに向けた高速テスト技術がアドバンテスト研究所と米Agere Systems社の共著論文として発表されている。タイトルは、「A New Method for Testing Jitter Tolerance of SerDes Devices Using Sinusoidal Jitter」(論文番号25.3)で、測定器と外部ループバックを組み合わるテスト手法である。
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