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HOMEエレクトロニクス電子設計ニュース・トレンド解説 > 東芝、Cadenceの新論理合成ツールでASICをテープアウト

ニュース・トレンド解説

東芝、Cadenceの新論理合成ツールでASICをテープアウト

  • 小島 郁太郎
  • 2017/07/24 11:54
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