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HOMEエレクトロニクス電子設計 > SystemVerilogベースの検証手法の標準化,米Accelleraが着手

SystemVerilogベースの検証手法の標準化,米Accelleraが着手

  • 小島 郁太郎=日経マイクロデバイス
  • 2008/05/08 13:57
  • 1/1ページ
米Accelleraは,SystemVerilogベースの検証用IPの標準化を狙った技術小委員会「Verification Intellectual Property (VIP) Technical Subcommittee (TSC)」を設立したと発表した

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