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HOMEエレクトロニクス電子デバイスLSI設計技能検定試験「ESA」過去問題解説集 > ≪問題≫Verilog-選択式19

  • エッチ・ディー・ラボ
  • 2012/09/26 00:00
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論理合成ツールで、階層を破壊(ungroup)したのちに論理の最適化(compile)をする。この時、次に示す回路と最適化の結果が正しければ「○」、誤っていれば「×」とし、正しい組み合わせを答えよ。ただし、面積最小の制約条件のみを設定したものと する。

< 回路図 >


< 選択肢 >
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