• BPnet
  • ビジネス
  • IT
  • テクノロジー
  • 医療
  • 建設・不動産
  • TRENDY
  • WOMAN
  • ショッピング
  • 転職
  • ナショジオ
  • 日経電子版

HOMEエレクトロニクス電子デバイスLSI設計技能検定試験「ESA」過去問題解説集 > ≪問題≫Verilog-選択式12

  • エッチ・ディー・ラボ
  • 2012/08/29 00:00
  • 1/1ページ

次の(1)、(2)、(3)の記述のうち、論理合成を行なった時にラッチを生成する記述を選べ。



解答と解説はこちら





* 解答と解説を見るには有料サービス「Tech-On!プレミアム」の加入が必要です。「Tech-On!プレミアム」の詳細はこちらから。

おすすめ